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layout versus schematic check

См. также в других словарях:

  • Layout Versus Schematic — The Layout Versus Schematic (LVS) is the class of electronic design automation (EDA) verification software that determines whether a particular integrated circuit layout corresponds to the original schematic or circuit diagram of the design.… …   Wikipedia

  • Design rule checking — or Check(s) (DRC) is the area of Electronic Design Automation that determines whether the physical layout of a particular chip layout satisfies a series of recommended parameters called Design Rules. Design rule checking is a major step during… …   Wikipedia

  • LVS — abbr. Layout Versus Schematic (check) (DRC, IC) …   United dictionary of abbreviations and acronyms

  • Electronic design automation — (EDA) is the category of tools for designing and producing electronic systems ranging from printed circuit boards (PCBs) to integrated circuits. This is sometimes referred to as ECAD (electronic computer aided design) or just CAD. (Printed… …   Wikipedia

  • Conception de circuits intégrés — La conception (ou le design) de circuits intégrés (ou puces électroniques) consiste à réaliser les nombreuses étapes de développement (flot de conception ou design flow) nécessaires pour concevoir correctement et sans erreurs une puce… …   Wikipédia en Français

  • Conception De Circuits Intégrés — La conception (ou le design) de circuits intégrés (ou puces électroniques) consiste à réaliser les nombreuses étapes de développement (flot de conception ou design flow) nécessaires pour concevoir correctement et sans erreurs une puce… …   Wikipédia en Français

  • Conception de circuits integres — Conception de circuits intégrés La conception (ou le design) de circuits intégrés (ou puces électroniques) consiste à réaliser les nombreuses étapes de développement (flot de conception ou design flow) nécessaires pour concevoir correctement et… …   Wikipédia en Français

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  • Design de circuits intégrés — Conception de circuits intégrés La conception (ou le design) de circuits intégrés (ou puces électroniques) consiste à réaliser les nombreuses étapes de développement (flot de conception ou design flow) nécessaires pour concevoir correctement et… …   Wikipédia en Français

  • Standard cell — For the battery used as a voltage reference, see Weston cell. In semiconductor design, standard cell methodology is a method of designing Application Specific Integrated Circuits (ASICs) with mostly digital logic features. Standard cell… …   Wikipedia

  • Physical verification — is a process whereby an IC layout design is checked via EDA software tools to see if it meets certain criteria. Verification involves DRC(Design rule check), LVS(Layout versus schematic), ERC (Electrical Rule Check), XOR (Exclusive OR), and… …   Wikipedia

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